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At a high level, Vega 10’s compute core is configured almost exactly like Fiji. This means we’re looking at 64 CUs spread out over 4 shader engines. Or as AMD is now calling them, compute engines. Each compute engine in turn is further allocated a portion of Vega 10’s graphics resources, amounting to one geometry engine and rasterizer bundle at the front end, and 16 ROPs (or rather 4 actual ROP units with a 4 pix/clock throughput rate) at the back end. Not assigned to any compute engine, but closely aligned with the compute engines is the command processor frontend, which like Fiji before it, is a single command processor paired with 4 ACEs and another 2 Hardware Schedulers.

On a brief aside, the number of compute engines has been an unexpectedly interesting point of discussion over the years. Back in 2013 we learned that the then-current iteration of GCN had a maximum compute engine count of 4, which AMD has stuck to ever since, including the new Vega 10.  Which in turn has fostered discussions about scalability in AMD’s designs, and compute/texture-to-ROP ratios.

Talking to AMD’s engineers about the matter, they haven’t taken any steps with Vega to change this. They have made it clear that 4 compute engines is not a fundamental limitation – they know how to build a design with more engines – however to do so would require additional work. In other words, the usual engineering trade-offs apply, with AMD’s engineers focusing on addressing things like HBCC and rasterization as opposed to doing the replumbing necessary for additional compute engines in Vega 10.


简而言之，目前4 组 compute engine/64CUs/64ROPs是农企工程师所能找到的最佳光栅化图形计算配比，虽然有可以增加更多CUs的方案但是需要更多的晶体管和能耗成本

so这个GCN构架到64CUs就已经over了，就算增加CUs也是成本跟性能提升不成正比。如果没有新的图形构架超越GCN，农企也就只能在HBCC和通用计算上下功夫

http://www.anandtech.com/show/11717/the-amd-radeon-rx-vega-64-and-56-review/2

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你贴的这段话中没有一句说这是个限制……

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原帖由 @yfl2  于 2017-8-17 12:45 发表
你贴的这段话中没有一句说这是个限制……

从功耗和晶体管可以看出限制，目前300瓦+功耗和500mm2核心才能达到1080水平

要达到titanXP至少也要650mm2+和4096bit HBM2，这样的产品成本就高达1000多刀，做出来也没有任何商业价值。

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原帖由 @u571  于 2017-8-17 12:48 发表
从功耗和晶体管可以看出限制，目前300瓦+功耗和500mm2核心才能达到1080水平

要达到titanXP至少也要650mm2+和4096bit HBM2，这样的产品成本就高达1000多刀，做出来也没有任何商业价值。

你这文不对题也是绝了……

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vega浮点性能提升还可以，规模不是真正的问题。

GCN时代农企旗舰的效率一向不怎么样吧
放大规模不会提升，但缩小也许会提升
当年Tahiti的能耗比跟Pitcairn比就跟屎一样

想当初老黄麦克斯韦的架构和开普勒相比，在28nm同代工艺下都做到了能耗比翻倍。农企也应该好好改变一下现在的架构了。只有把能耗比做上去，芯片做大做小才有余地。

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原帖由 ylgtx 于 2017-8-17 21:28 发表
想当初老黄麦克斯韦的架构和开普勒相比，在28nm同代工艺下都做到了能耗比翻倍。农企也应该好好改变一下现在的架构了。只有把能耗比做上去，芯片做大做小才有余地。

农企这些年的研发费用可能连老黄的一半都没有

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原帖由 @Nemo_theCaptain  于 2017-8-17 21:45 发表
农企这些年的研发费用可能连老黄的一半都没有

2016年研发投入，amd 1.0b，nvidia 1.4b
2015年研发投入，amd 0.9b，nvidia 1.3b
你可以说农企的市值连老黄一般都没（12b：99b），但研发这块农企绝对算舍得投入的

数据来源：
https://ycharts.com/companies/AMD/r_and_d_expense
https://ycharts.com/companies/NVDA/r_and_d_expense

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原帖由 昵称无效 于 2017-8-18 07:22 发表
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2016年研发投入，amd 1.0b，nvidia 1.4b
2015年研发投入，amd 0.9b，nvidia 1.3b
你可以说农企的市值连老黄一般都没（12b：99b），但研发这块农企绝对算舍得投入的

数据来源： ...

别忘了cpu部门要分走一大块啊

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原帖由 @昵称无效  于 2017-8-18 07:22 发表
2016年研发投入，amd 1.0b，nvidia 1.4b
2015年研发投入，amd 0.9b，nvidia 1.3b
你可以说农企的市值连老黄一般都没（12b：99b），但研发这块农企绝对算舍得投入的

数据来源：
https://ycharts.com/companies/AMD/r_and_d_expense
https://ycharts.com/companies/NVDA/r_and_d_expense

结果是cpu终于咸鱼翻身 gpu依旧停滞不前
大头给谁花了一目了然

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原帖由 @塌方  于 2017-8-18 08:04 发表
结果是cpu终于咸鱼翻身 gpu依旧停滞不前
大头给谁花了一目了然

大侠，请你分析一下前几年农企cpu被i3打全家时，研发投入比，是不是gpu部分吊打cpu部分？

还是钱太少，什么都想兼顾，但是显然做不到
而且amd自己主推了hbm显存，成本太高骑虎难下。
nv相对灵活的多了
听说三星还要涨显存的价格。我估计amd都不想生产vega了。估计5000的价格都是亏本的。

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原帖由 @昵称无效  于 2017-8-18 08:26 发表
大侠，请你分析一下前几年农企cpu被i3打全家时，研发投入比，是不是gpu部分吊打cpu部分？

ZEN你以为是一年两年就能憋出来的么
而且前几年被i3吊打全家的时候投入也没几个钱阿

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原帖由 @塌方  于 2017-8-18 08:35 发表
ZEN你以为是一年两年就能憋出来的么
而且前几年被i3吊打全家的时候投入也没几个钱阿

那不就得了，你也知道新构架2年憋不出来，ryzen好几年前就开始布局研发了，2015、2016的研发费用你又怎么知道花在哪里的，CPU有起色就拿前两年研发费想当然摊到CPU部分，这也太随意走心了吧